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Ergebnis der Suche nach: tit all "Sequential equivalence checking between system level and RTL descriptions."
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| Link zu diesem Datensatz | https://d-nb.info/1193837235 |
| Titel | Sequential equivalence checking between system level and RTL descriptions / by Shobha Vasudevan, Vinod Viswanath, Jacob A. Abraham, JiaJin Tu |
| Person(en) |
Vasudevan, Shobha (Verfasser) Viswanath, Vinod (Verfasser) Abraham, Jacob A. (Verfasser) Tu, JiaJin (Verfasser) |
| Organisation(en) | SpringerLink (Online service) (Sonstige) |
| Umfang/Format | Online-Ressource : online resource. |
| Persistent Identifier |
URN: urn:nbn:de:101:1-2019083121013765314696 DOI: 10.1007/s10617-008-9033-z |
| URL | https://doi.org/10.1007/s10617-008-9033-z |
| Zeitliche Einordnung | Erscheinungsdatum: 2008 |
| DDC-Notation | 004.2 (maschinell ermittelte DDC-Kurznotation) |
| Sprache(n) | Englisch (eng) |
| Beziehungen | Enthalten in: Design automation for embedded systems (Bd. 12, 26.11.2008, Nr. 4, date:12.2008: 377-396) |
| Sachgruppe(n) | 004 Informatik |
| Online-Zugriff | Archivobjekt öffnen |
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