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Link zu diesem Datensatz | https://d-nb.info/1278320245 |
Titel | Design and implementation of high speed, low complexity FFT/IFFT processor using modified mixed radix-24–22-23 algorithm for high data rate applications / by C. A. Arun, M. Sahayasheela, G. Gnanaguru |
Person(en) |
Arun, C. A. (Verfasser) Sahayasheela, M. (Verfasser) Gnanaguru, G. (Verfasser) |
Organisation(en) | SpringerLink (Online service) (Sonstige) |
Umfang/Format | Online-Ressource : online resource. |
Persistent Identifier |
URN: urn:nbn:de:101:1-2023011621100834861171 DOI: 10.1007/s41870-022-01128-z |
URL | https://doi.org/10.1007/s41870-022-01128-z |
Zeitliche Einordnung | Erscheinungsdatum: 2022 |
DDC-Notation | 004.6 (maschinell ermittelte DDC-Kurznotation) |
Sprache(n) | Englisch (eng) |
Beziehungen | Enthalten in: International journal of information technology (1.11.2022: 1-8) |
Sachgruppe(n) | 004 Informatik |
Online-Zugriff | Archivobjekt öffnen |
