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Art des Inhalts Hochschulschrift
Titel Parallelisierung des Viterbi-Decoders: Algorithmus und VLSI-Architektur / Gerhard Fettweis
Person(en) Fettweis, Gerhard (Verfasser)
Verlag Aachen : Universitätsbibliothek der RWTH Aachen
Zeitliche Einordnung Erscheinungsdatum: 1990
Umfang/Format Online-Ressource (pdf)
Hochschulschrift Dissertation, Techn. Hochsch., 1990
Persistent Identifier URN: urn:nbn:de:101:1-2509251049535.360691274639
DOI: 10.18154/RWTH-CONV-134702
URL https://publications.rwth-aachen.de/record/73469 (Verlag) (kostenfrei zugänglich)
Sprache(n) Deutsch (ger)
Beziehungen Düsseldorf : VDI-Verl, 1990 (Fortschritt-Berichte VDI : Reihe 10; 144)
Schlagwörter Digitalübertragung ; Viterbi-Algorithmus ; Parallelverarbeitung ; VLSI
DDC-Notation 004.2 (maschinell ermittelte DDC-Kurznotation)

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