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Titel Integration eines Hardwarebeschleunigers für Maschinelles Lernen in einen RISC-V RV32IM Prozessor über Memory-Mapped Register / Fabian Brünger ; Betreuer: Michael Karagounis
Person(en) Brünger, Fabian (Verfasser)
Karagounis, Michael (Akademischer Betreuer)
Verlag Dortmund : Fachhochschule Dortmund
Zeitliche Einordnung Erscheinungsdatum: 2021
Umfang/Format Online-Ressource (pdf)
Hochschulschrift Masterarbeit, Dortmund, Fachhochschule Dortmund, 2020
Persistent Identifier URN: urn:nbn:de:hbz:dm13-29988
DOI: 10.26205/opus-2998
URL https://opus.bsz-bw.de/fhdo/frontdoor/index/index/docId/2998 (Verlag) (kostenfrei zugänglich)
Sprache(n) Deutsch (ger)
Schlagwörter RISC* ; Prozessor* ; Hardware* ; Maschinelles Lernen* ; Field programmable gate array* ; Befehlsvorrat* (*maschinell ermittelt)
DDC-Notation 004.2 (maschinell ermittelte DDC-Kurznotation)
Sachgruppe(n) 004 Informatik

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